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崗位職責(zé):主要職責(zé)：1、 完成新產(chǎn)品設(shè)計(jì)，包括verilog代碼編寫，仿真驗(yàn)證，支持FPGA功能驗(yàn)證；2、 數(shù)字電路的綜合，時(shí)序驗(yàn)證，版圖布局布線后的時(shí)序分析，一致性檢查等；3、 生成測(cè)試矢量，協(xié)助測(cè)試工程師完成調(diào)試；4、 完成新產(chǎn)品的silicon validation和debug相關(guān)工作直至量產(chǎn)；5、 完成新產(chǎn)品開發(fā)過程中的文檔工作等 。 任職資格:1、 電子工程、微電子、通信、自動(dòng)化等相關(guān)專業(yè)，碩士及以上學(xué)歷；2、 3年以上數(shù)字電路設(shè)計(jì)經(jīng)驗(yàn)，具有扎實(shí)的數(shù)字電路理論基礎(chǔ)，熟悉代碼、驗(yàn)證、綜合等ASIC設(shè)計(jì)流程；3、 具有產(chǎn)品開發(fā)經(jīng)驗(yàn)者或具有ADC/DAC芯片開發(fā)經(jīng)驗(yàn)者優(yōu)先；4、 具有基本英語聽說讀寫能力，有較強(qiáng)的學(xué)習(xí)能力和團(tuán)隊(duì)協(xié)作精神 。 年齡要求：25-40歲 職能類別：數(shù)字前端工程師 關(guān)鍵字：熟悉ASIC流程產(chǎn)品開發(fā)經(jīng)驗(yàn)ADC/DAC開發(fā)